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Hybrid fpga engineer - rtl, vhdl/verilog & timing

Romano di Lombardia
Contratto a tempo indeterminato
Alten
Pubblicato il 20 maggio
Descrizione

Alten ricerca un FPGA ENGINEER per progettazione e sviluppo di logiche digitali su FPGA.
Scorra verso il basso per trovare i dettagli completi dell'offerta, inclusa l'esperienza richiesta e le mansioni associate.
Il candidato ideale ha una laurea in ingegneria e 1-2 anni di esperienza nello sviluppo FPGA, con conoscenza di VHDL e/o Verilog.
Le responsabilità includono simulazione e ottimizzazione delle prestazioni.
La posizione offre modalità di lavoro ibrida tra Milano, Pisa e Roma.
Alten promuove un ambiente inclusivo e accogliente per tutti i candidati. xrdztoy
#J-18808-Ljbffr

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